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mtechvlsi
Guest
Dies ist der LDO-Regler Circuits. Bitte überprüfen Sie diese und geben Sie mir eine Idee für die Umsetzung.
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M
mtechvlsi
Guest
plz bieten die LDO Circuit.
D
dick_freebird
Guest
Es ist die-35dB @ 10GHz, dass mir Risse auf. Sie können nicht HF-Schalter, um die in CMOS tun, sogar schwer in eine exotische Technologie. Und das ist mit einem 50-Ohm-Last. Eine hohe Impedanz auf der LDO-Ausgang? Vergiss es. Sofern Sie eine Drossel / cap-Filter nachgeschaltet setzen wollen.
R
ram_kumar_abc
Guest
es gibt immer einen Kompromiss zwischen PSRR und der Bandbreite. Deshalb denke ich, es wäre sehr schwierig, die vorgegebenen Spezifikationen zu erreichen.
J
jt_rf
Guest
Ich denke, das Problem muss auf System-Ebene behandelt werden. vor allem, wenn ur erwartet-40dB PSRR @ 10G.
N
nerdinsidestud
Guest
hallo FRN ... im auch mit der Gestaltung von LDO gesperrt ... i wud b hapy wenn jemand bietet mir ein Design n Layout LDO ...
M
mtechvlsi
Guest
Ich bin Design und Implementierung von verschiedenen Belastungen für on-Chip-Spannungsregler und Stabilität Analyse, bieten mir eine schmatics Diagramm.
M
mtechvlsi
Guest
plz geben Sie mir W / L, Mütze, Widerstandswert.
M
mtechvlsi
Guest
plz erzählen, was Änderungen nach diesem Bild & Ergebnis getan.