wie man Signale in einer tiefen Hierarchie in gemischten HDL in Modelsi

R

roger

Guest
wenn die Benutzung Verilog, haben wir
top.module1.module2.signal
aber wenn mit gemischten HDL
zum Extrahieren von Signalen innerhalb

<img src="http://www.edaboard.com/images/smiles/icon_cry.gif" alt="Crying or Very sad" border="0" />
 
Verwendung ModelSim Dienstprogramm

$ init_signal_spy ("??/??/ Signal "," Signal ", 1);

 

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